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1、数字电子技术基础课程复习大纲 %1. 考试说明 数字电了技术基础是一门理论性和实践性都很强的技术基础课。理论课考试形式为 闭卷考试，试卷满分为100分，期末考试成绩占一木课程总成绩80%,平时成绩占一20%（课 堂作业及期屮测验占10%,课堂考勤与实验占10%）。 考卷题型为填空题20分；选择题14分；是非题20分；分析计算题46分。 %1. 考试内容和基本要求 第一章数字逻辑基础 考试要求掌握逻笹代数的基木定律、公式及运算规则；掌握逻笹问题的描述与化简；理解 逻辑函数的真值表、表达式、卡诺图、逻辑图等表示的一致性；熟悉数制与码制。 考试内容 （?）数制与码制 （二）逻辑函数 1? 基木逻辑运
2、算 2? 逻辑函数与逻辑问题的描述 （三）逻辑代数的基本定律 （四）逻辑函数的代数变换与化简 （五）逻辑函数的卡诺图法化简 第二章逻辑门电路 考试要求：掌握TTL逻辑门电路的工作原理和技术参数；理解MOS f J电路的工作原理 ; T 解逻辑门电路使用屮的实际问题。 考试内容 （一）二极管、三极管的开关特性 （二）基木逻辑电路 （三）TTL逻辑门电路 （四）M0S逻辑门电路 第三章组合逻辑电路 考试要求：掌握逻辑电路的分析和设计的一般方法；熟悉编码器和译码器、数据选择器、 数字比较器、算术运算电路的分析与设计要点。 考试内容 （一）组合逻辑电路的分析和设计的一般方法。 （二）编码器和译码器 （
3、三）数据选择器 （四）数字比较器 （五）算术运算电路 第四章触发器 考试要求：掌握基本RS触发器、主从JK触发器、边沿触发器的真值表及其丁作特性。 考试内容： （一）触发器基木概念 （二）触发器触发方式 （三）JK触发器 （四）D触发器 （五）T触发器和T触发器 第五章时序逻辑电路 考试要求：掌握时序逻緝电路分析设计的一般方法；掌握寄存器、计数器的T作原理。考 试内容 （一）移位寄存器 （二）二进制计数器和BCD码十进制计数器 （三）时序逻辑电路分析与设计 1 .状态图、状态表及时序波形 2 ?同步时序逻辑电路分析与设计 3 ?异步时序逻辑电路分析与设计 第六章脉冲信号的产生与变换电路 考试要
4、求：掌握单稳态触发器、多谐振荡器的构成与工作原理；了解施密特触发器的电路 结构；了解555定时器的应用。 考试内容 （一）单稳态触发器 （二）多谐振荡器 1. H激多谐振荡器 2 .石英品体多谐振荡器 （三）施密特触发器（四）555定时器 %1. 复习题： 一、填空题： 1、 _ TTL TS （三态电路）的三种可 能的输出状态是 _ 、 _和_ o 2、 卡诺圈内的方格个数必须为 _ 个。 3、 _ 三态门主要用于总线传送电路信号。 4、 用低电平表示逻辑1,高电平表示逻辑0,这种逻辑体制称为 _ 逻辑。 5、 集成门电路缺口向左按正视图观察，引脚从小到大按_ 时针排列，编号最大的 是_ O
5、 6、 对于共阳型LED数码管，应选用输出_ 电平的显示译码器。 7、 _ 二进制计数 器利用反馈法纟R成N进制计数器时，异步复位时，计数至 _ 反馈；同步 置0时，计数至 _ 反馈。 二、选择题： 1、下列选项屮不属于卡诺图特点的是（ ）。 A、n变量卡诺图有2n个方格。 B、每个方格对应一个最小项。 C、相邻两个方格所代表的最小项只有一个变量不同。 D、每个方格按最小项编号排列。 2、 下列措施屮，不能减小三极管开关时间的是（）。 A、增大三极管饱和程度B、基极电阻并接加速电容 C、选用结电容小的三极管D、采用肖特基三极管 ） 。 ）。（多选题）C、悬空 3、 通常能实现线与功能的门电路是
6、（ A、0C | J B、TSL | J C、TTL与门D、74LS与门 4、TTL与门电路，多余输入端可接（ A、+VCC B、与有信号输入端并联 (D) J二0, K二 1 (D) J二0, K=0 三 、 1. 2. 3. . 6. 7. 8. 9. 10. 11. 12. 13. 14. 15. 16. 17. 5、若编码器编码输出位数为4位，则最多可对（）个输入信号编码。 A、4 B、8 C、16 D、32 6、全加器与半加器的区别为（）0 A、不包含异或运算 B、加数屮包含来H低位的进位 C、无进位 D、 有进位 7、具有透明特性的有（）。（多选） A、D触发器B、D锁存器 C、钟
7、控RS触发器D、主从型RS触发器E、主从型JK触发器 8、下列电路屮，不属于组合逻辑电路的是（）0 A、编码器B、译码器 C、数据选择器D、计数器 9、某移位寄存器的时钟脉冲频率为lOOKHz,欲将存放在该寄存器中的二进制数码左移8位, 完成该操作需要（）。 A 10us 80us C、lOOus D、800us 10、 _ JK触发器在 CP脉冲的作用下，欲使0屮=歹，则输入信号应为_ o (A) J二K二1 (B) J二0, K二Q (C) J二0, K二0 11、JK触发器在CP脉冲 的作用下，欲使Qn+1则输入信号应为 (A) J二K二0 (B) J二0, K二0 (C) J二0, 是
8、非题： 译码是编码的逆过程。 进制数的基数是指该进制数计数屮所川到的数码个数。 卡诺图化简示的卡诺圈数就是与或表达式屮的乘积项数。 用卡诺图化简逻辑函数的结果是唯一的。 三极管可组成与门电路，但不能组成或门电路。 组合逻辑电路设计是组合逻辑电路分析的逆过程。 共阴极LED数码管应选丿IJ有效输出为高电平的显示译码器来驱动。（竞争不一定会产 生冒险。 T触发髀具有将CP脉冲二分频的功能。 触发器也称半导体存储单元。 异步时序逻辑电路无白启动功能。 施密特触发器有两个稳态。 在数字电路屮，逻辑1比逻辑0大。 已知逻辑变量（A+B） C= （A+B） D,所以C=D。 ) ) ) ) ) ) ) )
9、 ) ) 74LS系列与门电路的多余输入端可以悬空。 组合逻辑电路中有具有记忆功能的逻辑部件。 两个半加器可组成一个全加器。 n Fii+B /1 Q 亠 A Q： (1) 2u 18.触发器电路结构形式与触发方式Z间有固定的对应关系。（） 19.同步触发器存在空翻现象，而边沿触发器和主从型触发器克服了空翻。（） 20.将T触发器的T端接0,就构成触发器。（） 21.同步时序逻辑电路具有统一的时钟CP控制。（） 22.555定时器不仅可以纟H.成多谐振荡器，还可以组成单稳态触发器、施密特触发器。 （ ） 四、分析计算题 : 1、FA, B, C,/n（0,1,4,5,6,7,9,10,11,1
10、3,14,15）的最简与或式。 3、某雷达站有3部雷达A、B、C,英屮A和B功率消耗相等，C的功率是A的功率的两倍。这 些雷达由两台发电机X和Y供电，发电机X的最大输出功率等于雷达A的功率消耗，发电机Y 的故大输出功率是X的3倍。要求设计? - 个逻辑电路，能够根据各雷达的启动和关闭信号，以 最节约电能的方式启、停发电机。 5、电路如图（“）、（b）、（c）、（d）所示，试找出电路屮的错误，并说明。 4、一个组合逻辑电路有两个控制信号Ci和C2，要求： （l）C2Ci=00 时，F = A 十B（2） C2G=OI 时，F = AB （3） C2Ci = 10时，F = A + B（4）C2C
11、I = H时，F = AB 试设计符合上述要求的逻辑 电路。 线译码器译码器和少量门器件实现逻辑函数F（C,B,A）=25、请用3-8 （） ,367）。 6、电路和输入波形 CP、A 如图 ）、）所示，设起始状态e2e,=oo,试画出 Q、Q、B、C的输出波形并说明。 CP rLTLTLTU“! A n I n n 丨 ? B (a) F严丽 ? (JD (b) A _ (c) 7、电路图如图（d）所示，输入信号CP、乩和D如图（b）所示，试iHidi Q , 0的波形并说 明。 部分复习题答案： 一、填空题： 1、 高电平、低电平、高阻 2、2n 3、 分时 4、 负 5、 逆,VCC 6、 低 7、N, N-1 二、选择题 : 1、D 2、A 3、A 4、A、B、C、E 5、C 6、B 7、B、C 8、D 9、B 10、A、C、D 11、A、B、D 三、是非题 : 1 、 2 、 3 、 错 对 对 错 错 I I I I I I I I I I I I | I(b) I I I I I I I I I I I I I I I I I I I I 6、 对 7、 对 8、 对 9、 错 10、 对 9、 错 10、 对 1、 错 2、 错 3、 对 4、 错 5、 错 6、 对 7、 对 8、 错 9、 对 10、 对