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1、数电实验1一实验目的1.了解掌握Quartus中原理图的设计方法2.了解掌握ED0实验开发板的使用方法二.实验设备1.Quartus开发环境2.ED0开发板三.实验内容要求 1： 根据参考内容，用原理图输入方法实现一位全加器。1）用 QuartusII波形仿真验证；2）下载到 DE0 开发板验证。要求 2： 参照参考内容，用 74138 3-8 译码器和 7400 与非门，用原理图输入方法实现一位全减器。1）用 QuartusII 波形仿真验证；2）下载到 DE0 开发板验证。四.实验原理1.实验1实现一位全加器原理图如下Ai，Bi为两个加数，Si为全加和，Ci-1为低位的进位，Ci为向高位的
2、进位。2.实验2用 74138 3-8 译码器和 7400 与非门实现一位全减器原理图如下。A0为被减数，A1为减数，Ci为来自低位的借位，CO为向高位的借位五.实验结果实验1：原理图输入波形仿真配置针脚在计算机上完成模拟实验之后，重新进行编译，然后将程序下载到DE0开发板上并对全加器进行验证。验证结果无误。实验2：原理图输入波形仿真六.故障排除&实验心得实验中，我们最大的问题就在于如何构建整个系统。整个实验都是比较基本的一些语句和一些简单门电路的综合使用。我们进一步的了解了整个系统的构建和编译过程，使我们对VHDL语句和Quartus的使用有了进一步的认识。个人认为，VHDL语言不够简洁，有些表示比较麻烦。这次实验首次让我们将数电理论运用到实践，增强了我们对于全加器和全减器的理解和运用，为我们将来的学习和工作提供了良好的基础。