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1、第2章 TMS320C54x DSP的结构原理 (片上资源),北京交通大学 电工电子教学基地,信号与系统,主要内容 第一节 C54x结构特点 第二节 C54x CPU的基本结构 第三节 存储器和寻址方式 第四节 CPU的状态和控制寄存器,第四节 CPU的状态和控制寄存器,C54有3个状态和控制寄存器： 一、状态寄存器0(ST0) (MMR:6) 二、状态寄存器1(ST1) (MMR:7) 三、处理器工作方式状态寄存器(PMST) (MMR:1D) 其中ST0和ST1中包含各种工作条和工作方式的状态PMST中包含存储器的设置状态及其他控制信息。,状态寄存器0(ST0)结构图,一、状态寄存器0(S
2、T0) 包含各种工作条件和工作方式,状态寄存器ST0各状态位的功能(1),状态寄存器ST0各状态位的功能(2),状态寄存器ST0各状态位的功能(3),状态寄存器1(ST1)结构图,二、状态寄存器1 (ST1) 包含各种工作条件和工作方式,状态寄存器ST1各状态位的功能(1),状态寄存器ST1各状态位的功能(),状态寄存器ST1各状态位的功能(3),状态寄存器ST1各状态位的功能(4),状态寄存器ST1各状态位的功能(5),三、处理器工作方式状态寄存器(PMST) 包含存储器的设置状态和控制信息,PMST结构图,PMST各状态位的功能(1),PMST各状态位的功能(2),PMST各状态位的功能(3),PMST各状态位的功能(4),*：仅LP器件有此状态位，所有其它器件上此位均为保留位 。,