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1、精品文档一、填空题（每题5分，10题，共50分）1. 功率 1W =_ 30dBm。2. 贴片电阻上的103代表10K欧姆阻值。3. 三极管在工作时，发射结和集电结均处于正向偏置，该晶体管工作在饱和状态。4. 假设A传输线的特征阻抗是 70欧姆，B传输线的特征阻抗是 30欧姆，A传输线与B传输线相连，那么它们之间的反射系数是_ 0.4。（ -0.4也可以是正确答案）5. Smith阻抗圆图的最左侧点对应的是 短路_，阻抗圆图的最右侧点对应的是 _开路_。6. 负载阻抗串联一个电感， 则输入阻抗在Smith圆图上如何变化？ 以负载阻抗点为起点，围绕等阻抗圆顺时针旋转 。7. 负载阻抗为Zl,经过
2、阻抗为，长度为入/4的传输线，则阻抗变为Z02/Zl 。8. 请写出级联网络的噪声系数计算公式NFtotal = NF1 + （NF2-1）/G1 + （NF3-1）/G2 +（NFn-1）/Gn-1 。9. 一个低噪声放大器的噪声系数为1.5dB,增益20dB,现在放大器的前端添加一个插损为1dB的无源滤波器，请问从滤波器的输入端看，这个电路的噪声系数是_2.5dB 。10. 请写出接收机的灵敏度计算公式Pin min = -174dBm/Hz + 10log（B） + NF + SNR out min ,使用B表示符号速率，NF表示噪声系数，SNFOut min表示解调门限。二、问答题（每
3、题10分，5题，共50分）1. 请分别解释放大器的1dB压缩点和噪声系数 NF的含义？（ 10分）答案：1dB压缩点（P1dB：放大器有一个线性动态范围，在这个范围内，放大器的输出功率随输入功率线性增加。 随着输入功率的继续增加，放大器进入非线性区，其输出功率不再随输入功率的增加而线性增加，也就是说，其 输出功率低于小信号增益所预计的值。通常把增益下降到比线性增益低1dB时的输出功率值定义为输出功率的1dB 压缩点，用P1d表示。噪声系数：放大器本身自带噪声，在放大输入信号和输入噪声的同时，也会将自身的噪声禾0放大后的输入信号和 输入噪声叠加，导致输出端的信噪比减小； 噪声系数NF输入端信噪比
4、/输出端信噪比2. 请分别画出BUCK和BOOS电路的原理框图。（10分）BUCK路:精品文档精品文档BOOS电路:3. 请画出典型的一次变频超外差式接收机的结构框图，并简要描述。（10分）射频输入带通滤波器LNA低噪声放大器MIXER混频器带通滤波器中频放大器ADCFPGA答案:射频输入后，经过带通滤波器，抑制带外信号后，送入 LNA放大,放大后的信号经过混频器，变频到中频 段 再经过带通滤波器抑制镜像干扰，然后送入中频放大器，再送入AD进行模数转换，最后送入FPG进行数字 信号处理。4.4. 请将下图所示的英文翻译为中文。（10分）A single-ended CMOS clock can
5、 be ac-coupled io the CLKP input, with CLKM connected to ground with 启 0.1 亠jjF capacitor, as shown in Figure 136. However, for best performanoe the clock inputs must be driven differentially, thereby reducing $u$cepi曲ility to ccmirion-mode noise. For high Input frequency sampling, Tl recommertcis u
6、期命 a clock source with very low jitter. Band-pass filtering of the clock source can twlp reduce the effects of jitter There is no clhange in fjerfomance wiih a non-50% duty cycle clack input.精品文档答案：使用交流耦合的方式将单端CMO时钟信号送人CLK引脚，CLKI引脚使用0.1uf的电容耦合至哋，女吓图 136所示。然而，要实现最优性能必须使用差分输入，因为可以减小共模噪声的干扰。为实现高频输入采样， TI 推荐使用低抖动时钟。带通滤波器可以减小抖动带来的影响。非占空比50的时钟信号不会影卩向AD（的性能。6.7. 某型号频谱仪低噪为-165dBm/Hz，当RBW设为lOOKHz时，能否区分出幅度为-120dBm 左右的单音信号？如希望准确测量此单音信号的幅度，同时希望尽量节约测试时间，RBW应如何设置？（ 1O 分）答案：测不出；如陳需要测量，将RBWT成1OKHz