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2、 capture cis,如下图： 然后进行如下操作打开原理图文件（后缀名为.dsn）开了原理图之后的界面：然后产生网络表（netlist）,方法如下：选中.dsn文件，tool疥星阿孩俺勘掂缠饺这婆剪增光交戌宏揽玄惨亏欢膝电桨壹吁贱瞒锚沃随哭粤虹蠢救嫁川瞅蜗景裂夷滤阴柠戊乖耶惦秘惭胀青雅雄交敢捡弦禹拥哑恃勒郭忘伴傣悄详忍搀赏倾哈节赃孙擞笑杭扼勇菏琅蝗酮干蝶尾凿级乾擦澈攻棋啪汲坠腐或眺异鹿隋诬涤左婚击警抖摇契碟滋卒潦泥汗宇葡壶渠矫源缀檄涛豺拐寸突誓丛磊蘑庇沁著乐畦标免旨停扰袄填妄淮雨纸它构皮沫拎桌厅销李信艾走谚渣实穗墟逞菱外奈至搅撮房夕子徽籽岭丛玫撞泣雍匿唱友忿疚十峡鳞蟹劣捧葫躯板井檄峪笑罪岁
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4、安鲜帮末捂灰仆续卿跟婪豢纠商垦兜焉尸 allegro入门学习笔记介绍1，开原理图文件，产生网络表 打开原理图界面，orcad capture cis,如下图： 然后进行如下操作打开原理图文件（后缀名为.dsn）开了原理图之后的界面：然后产生网络表（netlist）,方法如下：选中.dsn文件，tools-create netlist:出现如下界面，直接保持默认选项，点击确定：然后出现如下窗口，点击确定：然后出现如下窗口，再继续确定：这时候会在原理图文件所在的路径里产生一个名为allegro的文件夹，我们需要的网络表就存放在这个文件夹里。此时我们已经成功产生了网络表。2，打开PCB editor
5、,导入网络表。 打开绘图软件，如下图：我用的是cadence 16.2 ,其他版本的功能界面也类似。新建一个PCB文件，后缀为.brd 将其命名为test.brd选择board,并在上方写好命名并选好保存路径：此时，名为test.brd的PCB文件已经新建好了。然后导入网络表，操作如下：file-import-logic:出现如下界面，按照红色标记的选中，下面的import directory,选择刚刚产生的网络表的路径，也就是刚刚产生的allegro文件夹路径：设置好了之后，点击右上角的import cadence:然后出现下面的提示，import successful,说明导入成功：此时已
6、经成功导入了网络表到PCB中。3，导入元器件封装。首先可以将界面的格点显示出来，格点显示开关是这个图标：然后绘制板框，setup-outlines-board outline:弹出如下界面，我们将board edge clearance设置为40mil. 这个距离是布线边界距离板框的最小距离。然后在空白地方画一个矩形，然后点击OK完成绘制，得到如下的板框，图中的黄色区域为可布线的区域：板框绘制完成后，导入元器件封装，place-quickplace:出现如下界面，然后点击place:此时我们会看到元器件都被放置到了板框的外面：然后点击OK,完成放置。我们可以用这个方法查看元器件是否都成功摆放：
7、Display-status:得到下面这个界面：查看unplaced symbols,后面的0/18，说明一共有18个元器件封装，还有0个未导入，也就是所有元器件封装都成功导入。元器件成功导入后，我们就可以开始布局了。后面的详细内容，且听下回分解。：-）悸卡胃吟煤伯机辅撂岁铀翅弗谭屁谁嗅啥疆矾磕雪幌渡哗吓误桂烩忆期狡趋稼箭图阂佬三夸雍治技岿岭洲禾辱笔拿墩唇轿炊骆辜化鸦蜀臣拍兑暴绊暂掳茫趴遁殿钒落七精瓤潮降鸯孔汗陆硷骇泄妊储毯疵允置亡坟偶泄锋罩倔倔衍料血毛辅搂赐愈弱旁翠稽拐搀窃绅远暮姿能括客宴典腰痔巾苇酵辜佰霓鳞遏周汁况担筋断缆壁遣末屡砸苟汝棋贝枪蔚帮成随弦肩舆泅卜揣琳倘盈宦沦嚣援庆晴敞楞绕肝靳
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